Simple Project List 軟體列表

VHDL/Verilog
23 projects in result set
最後更新: 2009-08-30 05:19

verilog compiler

Java と JavaCC を使用して書かれて verilog の言語のコンパイラです。ネットリスト, セルのすべての接続の ascii テキスト ファイルを生成します。それは多くのモジュールで構成されています、非常に大規模な回路をコンパイルできます。

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最後更新: 2012-12-06 07:20

MiniLA - logic analyzer SW & HW

MiniLA ロジック アナライザ ソフトウェアおよびハードウェア

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最後更新: 2009-06-29 06:48

crc-gen-verilog-vhdl

CRC の発電機は任意データ幅 1 ~ 1024年の CRC の Verilog または VHDL コードを生成するコマンド ライン アプリケーションと多項式幅 1 ~ 1024年です。コードは、Win32 では、簡単に他のプラットフォーム用ポータブル バスの C で書かれて

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Development Status: 5 - Production/Stable
操作系統: Windows XP
程式語言: C, VHDL/Verilog
使用者介面: Command-line
最後更新: 2015-12-10 04:26

ghdl-updates

GHDL は主要なオープン ソース VHDL シミュレータです。しかしそれは近年少し発展してきたし、gcc の新しいバージョンでビルドすることは困難です。Gcc - 最初の gcc4.8 を一緒に来ると、新しいリリースで最新の状態に維持を目指します。またように修正と機能拡張できるようにします。Http://home.gna.org/ghdl/で元 ghdl ウェブサイト操作に残りますが、このプロジェクトの背後に遅れることがあります。現時点では、ここから GHDL を取得 Mercurial リポジトリからスナップショットを引っ張ってくると、ソースからのビルドを意味します。我々 は「ファイル」セクションでは、スナップショットのソースを配置しても、我々 はあまりにもそれらを追加バイナリのビルドが利用可能になった。詳細については、Wiki をご覧ください: https://sourceforge.net/p/ghdl-updates/wiki/

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最後更新: 2012-04-26 07:35

SystemVerilog FrameWorks(TM)

これはツールというベース検証環境を開発しているエンジニアを支援するためにコードのライブラリのコレクションです。コンポーネントにはユーティリティ ライブラリ、スコアボードおよびシャット ダウンのマネージャー実装、登録ツールなどが含まれます。

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最後更新: 2014-04-03 09:35

GXSM

GXSM - Gnome X 顕微鏡: マルチ チャンネル画像とベクトル プローブ データ獲得と可視化システムもスパ LEED が SPM 技術 (STM、AFM.) のために設計。プラグイン インターフェイス ユーザー アドオン データ処理と特別なハードウェアや楽器サポートことができます。いくつかのハードウェア オプションに基づいてそれ最も柔軟で適応的に市販の DSP ハードウェアと低レベル信号処理タスクと楽器の提供もオープン ソース コード コントロールのサポート。すべての最新ソフトウェア CVS のみまたはライブ デモ/インストール CD を介して入手可能です: http://www.ventiotec.de/linux/GXSM-Linux.iso

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最後更新: 2006-12-24 11:45

The SBus (Synergy Bus) Project

SBus はネットワークとデバイス間の通信に適した高速パケット ベース databus 標準のファミリです。データの高密度トランザクションに最適化されています。このプロジェクトを作成し、標準、概略図、およびドライバー

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最後更新: 2007-07-14 03:18

FALCON Object Recognition System

これは認識システムをオブジェクト賞を受賞したファルコンです !6 倍以上、CMUCam の raw 解像度と最大 12 の異なるオブジェクトを同時に追跡可能なこれはそのクラスで最も強力なビジョン システムです。

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